Name: Digitaler Entwurf von SDRAM auf Verilog (en Alemán)
Price: 53270.00 CLP
Availability: InStock
Author: Kumar, Abhishek ; Singh, Ritesh
ISBN: 9786205313794

portada Digitaler Entwurf von SDRAM auf Verilog (en Alemán)

Digitaler Entwurf von SDRAM auf Verilog (en Alemán)

Formato

Libro Físico

Autor

Abhishek Kumar

Ritesh Singh

Editorial

Verlag Unser Wissen

Idioma

Alemán

N° páginas

Encuadernación

Tapa Blanda

Dimensiones

22.9 x 15.2 x 0.3 cm

Peso

0.09 kg.

ISBN13

9786205313794

Digitaler Entwurf von SDRAM auf Verilog (en Alemán)

Abhishek Kumar (Autor) · Ritesh Singh (Autor) · Verlag Unser Wissen · Tapa Blanda

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Reseña del libro "Digitaler Entwurf von SDRAM auf Verilog (en Alemán)"

Entwurf eines synchronen dynamischen Direktzugriffsspeichers (SDRAM) mit 8 MB x 16 x 4-BAnk (512 MB) unter Verwendung der Hardware-Beschreibungssprache Verilog, der in jeder speicherbasierten Anwendung eingesetzt werden kann. Heutzutage verwenden Computer und andere elektronische Systeme, die gro e Mengen an Speicher benötigen, DRAMs als Kernspeicher. Aufgrund der einzigartigen Transistorzellenstruktur des DRAM können extrem dichte Speichernetzwerke in einem einzigen Baustein mit relativ geringem Platzbedarf aufgebaut werden. Der herkömmliche DRAM wird asynchron gesteuert, so dass der Systementwickler die Standby-Zustände manuell einfügen muss, um die Spezifikationen des Bausteins zu erfüllen. Das Synchronisierungstiming hängt von der DRAM-Geschwindigkeit ab und ist unabhängig von der Systembusgeschwindigkeit. Diese Beschränkungen der Synchronisation haben zur Entwicklung des SDRAM geführt, das im Wesentlichen ein schneller DRAM mit einer synchronen Hochgeschwindigkeitsschnittstelle ist. Eingangs-/Ausgangs- und Controllersignale werden mit einem externen Taktgeber synchronisiert, was dem Entwickler neue Möglichkeiten eröffnet. Vereinfachte Schnittstellenschaltungen und ein hoher Bandbreitendurchsatz können mit SDRAM im Vergleich zu herkömmlichem DRAM erzielt werden.